Raffaele Zippo, PhD
Postdoctoral Researcher
University of Pisa
PhD in Smart Computing
Universities of Firenze and Pisa
MSc in Computer Engineering
University of Pisa
Bio
I enjoy studying problems and coding solutions.
Per dubbi, chiarimenti, curiosità. Vi è utile, sfruttatelo.
L'orario ufficiale è ogni Lunedì dalle 16:00 - 18:00, ma può variare per impegni concomitanti.
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- Esercitazioni di Verilog, utilizzando Icarus Verilog
- Quality of Service in predictable heterogeneous architectures
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Relatori: Prof. Giovanni Stea, Dott. Raffaele Zippo
Validation of an Interference-aware model to predict the memory sub-system performance using Gem5 simulator
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Riccardo Bertini
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M.Sc. in Computer Engineering
Edoardo Loni
Relatori: Prof. Giovanni Stea, Dott. Raffaele Zippo